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浮地 · 寄生电容 · 共模回路电路已经浮地,为何高频干扰还能钻进来?浮地切断的是有意连接,寄生电容仍在替高频电流搭桥 浮地系统与保护地或机壳没有直接导线连接,但模块、屏蔽层、线缆和相邻铜皮之间仍存在寄生电容。频率升高后,寄生容抗下降,共模
EMC · 共模电感 · 电流方向共模电感串进电源,为何不挡正常电流?关键不是两根线都穿过磁芯,而是两股电流在磁芯里怎样叠加 电源的正常去回电流大小接近、方向相反,在共模电感磁芯中产生的磁通会相互抵消;共模噪声在两根线上同向流动,磁通反而相
EMC · 磁珠 · 阻抗曲线磁珠标着600Ω,为何不能当成固定电阻?600Ω只对应规定频率附近的交流阻抗 图 2 磁珠可用电感、损耗和寄生电容理解磁珠上的600Ω不是直流电阻,也不是所有频率都保持600Ω。它通常表示器件在规定测试频率
EMC · 差模辐射 · 环路面积时钟频率并不高,辐射为什么还有高频峰?差模环路更怕快边沿差模辐射由高频能量、环路面积和环路电流共同决定,时钟标称频率只是起点 图 1 信号去程与回程围成差模辐射环路(原理示意)数字信号的快速边沿包含高频成
EMC · 单点接地 · 公共阻抗地线都接到同一个点了,为什么高频反而更差?路径太长也会变成阻抗接地方式的目标不是统一名字,而是让关键电流不共享错误阻抗单点接地能减少某些低频公共路径耦合,但连接到单点的导线在高频下会呈现明显电感和阻抗。多点
射频基础 · 传输线 · 反射系数负载不是50Ω,反射到底有多严重?先看反射系数的大小和正负号反射系数同时告诉你:反射多少,以及反射后是同相还是反相当传输线遇到与特性阻抗不同的负载时,入射波的一部分会被反射。反射系数 ρ 的幅度表示反射强弱
从频谱诊断到PCB整改,训练真正能落地的EMC思路做硬件的人迟早会遇到 EMC。样机功能都正常,一送测,传导超标;换个线缆,辐射又冒出来;静电一打,系统复位;浪涌一来,接口挂掉。很多新人第一次进实验室,会下意识地开始“试器件”:加磁珠、换电
图:EMC 学习最终要回到真实仪器、真实板卡和真实问题。这两天看就业和工程岗位相关信息,有个点挺适合拿来聊:电气、电子工程不是没人要了,而是“只会说概念”的人越来越难混。美国劳工统计局 2026 年 7 月 2 日发布的 6 月就业形势摘要
很多新手画 PCB 时,一看到“地线”两个字,就下意识把它加粗,觉得越粗越稳、越粗越抗干扰。低速电源板里,这个做法有时问题不大;但到了高速数字电路、射频接口、DDR、USB、以太网、AI硬件板卡里,地线盲目加粗不一定有用,还可能破坏回流路径
传导发射超标,第一反应就是加共模电感。结果换了三个型号,电感量从10mH换到100mH,测试结果还是压不下去。钱花了,板子改了,问题没解决。问题不在电感量不够,而是根本没搞清楚噪声的传播路径和模式。共模电感不是万能的共模电感只抑制共模电流—
在电子产品研发领域,EMC(电磁兼容性)和 EMI(电磁干扰,即无用辐射)往往是令硬件工程师和项目经理最头疼的"玄学"问题。回顾行业发展,EMI 问题的大规模爆发,始于信号处理电路从纯模拟向数字化转变的时期。在纯模拟时代,EMI 几乎不构成威胁,这也导致早期的研发人员普遍缺乏防范意识。如今,在全面数
EMC辐射骚扰整改,两天时间把主控芯片加屏蔽罩、晶振做包地、电源输入加滤波器,能想到的招全上了,测出来骚扰还是超。再三确认每一步都做到位了,最后用近场探头顺着板子扫了一遍,发现在一根排线附近场强最高。换了这根排线的走向,骚扰直接降了10dB
痛点同事调EMC,整整改了两天,示波器探头、频谱分析仪、近场探头轮番上,换屏蔽罩、加磁环、调时钟走线,愣是没把辐射骚扰那个尖峰压下去。最后把板子翻过来一看,板内一根扁平排线裸奔着从MCU伸到外接传感器,问题就出在这儿。这种情况我见过不止一次
时钟走线两侧加了地线包围,本想屏蔽干扰,结果辐射测试反而超标。不是地线没用,是你把它变成了天线。1、包围地变成了环形天线时钟线两侧各跑一根地线,如果两端都接地,恭喜,你造了一个环路天线。时钟信号是方波,高频谐波丰富。这些谐波电流在环路中流动
外壳明明接了保护地,ESD一打,内部芯片照样挂。不是地没接好,是你的地根本没来得及"接住"那一击。1、问题出在速度ESD放电时间是纳秒级,上升沿不到1纳秒。这么快的瞬态,电流不会老老实实走低阻抗的保护地线。它走的是阻抗最低的路径,而纳秒级下
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