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90天全能特训班17期 allegro -马晓轩 -百兆网口-作业评审

2023-02-21 15:14

2612

差分出线尽量耦合

2.打孔从底层进行连接即可

3.滤波电容靠近管脚放置

4.焊盘出线需要优化

5.四组差分需要进行对内等长，误差5mil

6.时钟信号需要单根包地处理

以上评审报告来源于凡亿教育90天高速PCB特训班作业评审

如需了解PCB特训班课程可以访问链接或扫码联系助教：

https://item.taobao.com/item.htm?spm=a1z10.1-c-s.w21136784-21870440400.21.5c7b5284NnAAq6&id=601258730169

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1.器件重叠，焊盘重叠会导致器件无法焊接。2.底层没有铺铜处理3.过孔应打到走线最后一段，完全包围走线。以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教：https://item.t

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答：在导网表时，如果碰到有缺失Flash的报错，而正好缺失的Falsh在另一个项目中使用过，我们可以从另一个PCB中调用，具体的步骤如下：第一步，打开PCB，点击File-Export-Libraries…，在弹出的对话框中勾选Shape and flash symbols、No library dependencies选项，设置好导出的文件夹路径，点击Export导出，如图4-111所示；

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答：在使用动态铜皮的时候，会出现对铜皮进行Update to Smooth完了，还存在Out of date shapes的现象，如图6-332所示：

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