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走线未连接到过孔中心2.器件干涉3.时钟信号等长不符合规范4.滤波电容尽量靠近管脚摆放，尽量一个管脚一个5.直接在电源层铺一个整版电源即可以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系
差分锯齿状等长不能超过线距的两倍2.注意过孔不要放置过孔上3.T点打孔尽量对齐4.D1未添加pin pair进行等长，存在报错5.地址线也存在报错6.后期自己在电源层和地层铺铜进行连接以上评审报告来源于凡亿教育90天高速PCB特训班作业评审
晶振需要走内差分处理2.SDRAM数据线低八位和高八位需要分开创建class，分别进行等长3.注意数据线之间等长需要满足3W规则4.地址线也需要满足3W规则5.滤波电容靠近管脚放置，尽量保证一个管脚一个6.数据线等长误差建议+-25,mil
晶振布局需要调整2.焊盘出线不规范3.USB这对差分走线需要耦合，对内等长误差5mil4.没有添加USB控90的class，创建差分对5.vbut属于电源信号，走线需要加粗6.此处不满足载流以上评审报告来源于凡亿教育邮件公益作业评审如需了解
1.布线尽量避免从焊盘宽方向和四角出线，多处出线从宽方向出线。2.需要加粗的走线在焊盘里面需要和焊盘一样宽，出焊盘后再加宽。3.走线避免锐角和线头4.存在很多尖岬铜皮、碎铜、直角锐角铜皮5.继电器和电感容易影响其他信号和污染地网络，器件下方
数据线一组只有9根线，其他信号不要添加进来，高八位少一根LDQM12.数据线和地址线建议添加一根最少20mil的地线进行隔开3.过孔里存在多余的线头4.地址线分组错误，有电阻几根网络也需要添加进来进行一起等长，还有时钟信号5.走线需要从焊盘
1.485需要走内差分处理2.跨接器件旁边尽量多打地过孔，间距建议2mm3.晶振下面尽量不要走线4.差分走线不满足间距规则以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教：https
1，输入电容靠近管脚放置2.反馈路劲从最后一个电容后面取样3.焊盘出线不规范，焊盘中心出线至外部才能拐线处理，避免生产出现虚焊4.跨接器件旁边尽量多打地过孔5走线不要有任意角度，尽量从焊盘中心出线6.铺铜和走线选择一种即可7.pcb上存在d
数据线分组错误2.地址线分组错误3.焊盘出线不规范，焊盘中心出线至外部才能拐线处理，避免生产出现虚焊4.走菊花链的结构，等长应该是BGA到SDRAM,然后再从SDRAM到FLASH5.相邻焊盘是同网络的，不能直接相连，需要先连接焊盘之后在进
跨接器件旁边尽量多打地过孔2.此处为电源网络，线宽需要加粗3.确认一下此处是否满足载流，线宽尽量一致4.晶振下面不要走线5.差差分之外，其他的信号都需要加粗到20mil6.器件摆放不要挡住1脚标识7.注意等长线之间需要满足3W规则，与时钟信
