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绿色的铜皮是修改后没有重铺的铜皮属性要选择这一项这个vcc12v的走线要加粗处理最好铺铜连接这里要出线后在连接dcdc需要单点接地输入输出主干道要铺铜连接这个反馈不要走电感下面而且要从最后一个电容处拉出来散热过孔两面都要做开窗处理以上评审报

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PCB Layout 2023-11-27 15:40:39
ZC-第一次作业-DCDC模块的PCB设计作业评审

电感下面不要放置器件,自己优化下:此处DCDC5.0V输入建议铺铜处理以满足载流大小,或者加粗走线的宽度能满足:此处存在铜皮瓶颈处,自己优化下:此处LDO电路中的电源信号能顶层连接的,就把过孔删掉:存在多处情况。右边的LDO电源信号存在上述

全能19期-常密生-第二次作业-PMU

1.232的升压电容走线需要加粗2.走线尽量不要从小电阻电容中间穿线,容易造成短路3.USB走线不满足差分间距规则,可以打孔4.焊盘出线需要优化一下,拉出焊盘在进行加粗5.晶振需要包地处理,其他信号线不要从晶振里面穿6.USB差分对内等长5

90天全能特训班18期 AD --iYUN-STM32

差分换层旁边打回流地过孔差分出线尽量耦合时钟线单根包地打孔处理变压器出差分以外所有线加粗到20mil以上地焊盘就近打孔连接到大地铜存在飞线没有处理布线尽量短,不要绕线负片没有灌铜RX、TX分别建立等长组控100mli误差进行等长以上评审报告

90天全能特训班21期-LHY——第六次作业——千兆网口绘制

差分对内等长凸起高度不鞥超过线距的两倍2.主要差分出线要尽量耦合3.差分需要进行对内等长,误差5mil4.器件摆放尽量中心对齐处理5.CC1和CC2属于重要信号,走线需要加粗6.注意走线不要有任意边,后期自己优化一下走线7.包地的地线上尽量

90天全能特训班19期allegro -邹测景-USB

顶层BGA里面的碎铜可以挖掉2.反馈信号走线需要加粗3.等长存在误差报错4.注意晶振下面不要走线以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:https://item.taoba

90天全能特训班17期 AD - 李天昊-达芬奇

差分线锯齿状等长不能超过线距的两倍很多差分都存在同样的问题,后期自己修改一下2.注意差分走线要尽量耦合3.一对差分只用进行对内等长,不用两根都进行绕蛇形4.滤波电容尽量靠近管脚摆放,走线加粗,需要优化一下以上评审报告来源于凡亿教育90天高速

90天全能特训班18期 allegro -觅一惘 -4DDR

RS232这几个电容属于生压电容,走线需要加粗2.VBAT电源尽量加粗到20mil3.USB差分对内误差5mil4.差分包地,地线上尽量多打过孔以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫

90天全能特训班18期-allegro -Mr.韩-STM32

电感所在层的内部需要挖空处理2.差分线处理不当,锯齿状等长不能超过线距的两倍3.走线未连接到过孔中心,存在开路4.VREF的线宽需要加粗到15mil以上5.焊盘需要开窗处理6.器件干涉7.此处出线载流瓶颈,自己加宽一下铜皮以上评审报告来源于

90天全能特训班17期AD -阿浩 -2DDR-作业评审

pcb上存在短路2.滤波电容靠近管脚放置,走线加粗3.晶振下面尽量不要走线4.此处电源不满足载流5.变压器所有层挖空6.变压器除差分信号外,其他信号都需要加粗到20mil7.差分线对内等长处理不当,锯齿状等长凸起高度不能超过线距的两倍8.走

90天全能特训班16期AD-晨曦-千兆网口-作业评审