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差分线对内等长凸起高度不能超过线距的两倍2.差分对内绕等长绕一边即可3.走线需要优化一下,尽量不要走任意角度4.差分出线需要优化一下5.存在开路6.地网络尽量就近打孔连接到地平面走线尽量不要超过器件外框丝印,走线离焊盘太近,后期容易短路差分

90天全能特训班21期 pads-康斯坦丁-HDMI

晶振需要走内差分,并且包地打地过孔2.变压器所有层需要挖空处理3.差分线处理不当,锯齿状凸起高度不能超过线距的两倍4.此处差分走线不满足差分间距规则5.差分对之间不用进行等长,差分对内等长即可,误差5mil6.此处需要添加一个2MM的隔离带

90天全能特训班17期 allegro -马晓轩 千兆网口-作业评审

差分换层需要在旁边200mil范围内打回流地过孔电源走线注意加粗usb座子到esd器件之间也需要建立差分对,对内误差控制5mil等长差分对内等长不符合规范差分对内等长误差超过5mil负片没有指定网路多处孤岛铜皮、尖岬铜皮以上评审报告来源于凡

90天全能特训班20期-AD-思乐-usb3.0-type c

VGA模拟信号要一字型布局,走线加粗处理2.晶振需要走内差分,走线要尽量短,晶振尽量顶层走线,包地要包完整3.差分对内等长不能超过线距的两倍,包地要在地线上打孔4.跨接器件旁边需要多打地过孔,器件摆放可以在优化一下5.反馈需要从最后一个电容

90天全能特训班19期 AD -朱腾-达芬奇

DD3 四片:注意不要出现这种锐角走线:负片层并未赋予网络:注意设计完了之后检查下走线的连接性:并未保证3W间距原则:差分对内等长注意规范:差分对内等长误差为5MIL:以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特

AD-全能20期-AD-xiaohao-第六次作业-DDR3模块

差分对内等长凸起高度不鞥超过线距的两倍2.主要差分出线要尽量耦合3.差分需要进行对内等长,误差5mil4.器件摆放尽量中心对齐处理5.CC1和CC2属于重要信号,走线需要加粗6.注意走线不要有任意边,后期自己优化一下走线7.包地的地线上尽量

90天全能特训班19期allegro -邹测景-USB

网口信号除差分外,其他的都需要加粗到20mil2.差分走线可以在优化一下3.晶振需要走内差分,并且包地处理4.走线尽量钝角,不要有尖角5.差分对内等长存在误差报错6.走线尽量不要从小器件中间穿,后期容易造成短路7.注意器件摆放不要干涉8.顶

90天全能特训班19期allegro -谢程鑫-千兆网口

铜皮间距太小,所有间距最小不能小于4mil多处孤岛铜皮、尖细铜皮差分出焊盘尽快耦合优化布局走线尽量靠近,不会可以查看参考板走线太细,走线一般情况最细4mil,明明可以走4mil线宽差分对内等长绕线在引起不等长处绕线差分对内等长绕线拱起处长度

90天全能特训班22期-魏信-AD-第五次作业-USB3.0 PCB设计

差分信号之间要用GND隔开:差分需要包地处理:此处打了两个孔,连接也两个都连接上,不然另一个孔没有意义:注意差分信号都需要包地处理:注意差分对内等长gap需要大于等于3w:没满足的都去重新等长下。差分对内等长误差为5MIL:以上评审报告来源

全能19期-Charlie 吴-第5次组作业-USB 2.0/3.0&Type-C模块PCB设计

跨接器件旁边尽量多打过孔,地分割间距尽量1mm,有器件的地方不满足可以忽略2.差分对内等长误差5mil3.差分走线需要优化一下4.晶振走内差分,需要包地处理5.走线没有连接到焊盘中心,存在开路6.未创建RX和TX class,误差范围100

90天全能特训班18期AD-谭晴昇-千兆