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建议顶底层可以铺上大地铜：铜皮注意这种尖角：注意此处的铜皮 不要铺到晶振内部，晶振需要净空：晶振包地处理沿着器件丝印边框打孔：跨接器件两边可以多打地过孔：差分打孔换层的两侧可以放置地过孔，缩短回流路径：此处晶振净空调整下：等长之间注意保持3
注意地址线等长需要满足3W2.数据线之间也需要满足3W规则3.注意不要出现stub线头，后期自己处理一下4.注意过孔不要上焊盘5.电气网络的几根信号线需要和地址线组一起进行等长以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解
1.dcdc需要单点接地，gnd网络需要连接到一起在芯片下打孔。2.相邻电感不能平行摆放，需要朝不同方向垂直放置。3.下面一路dcdc电源输入需要加粗，加宽载流从第一个器件输入。以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了
此处铜皮可以在优化一下，不美观2.存在没网络过孔，过孔不添加网络就没法进行连接，就是开路的3.注意铺铜要连接到焊盘上，这个是开路的4.pcb上存在多处开路5.注意除了散热过孔，其他的都需要盖油处理以上评审报告来源于凡亿教育90天高速PCB特
器件摆放太近，后期安装容易干涉2.与上述问题一样，期间这样，后期没法焊接，放不下3.网口差分需要进行对内等长，误差5mil4.网口除差分信号外，其他信号都需要加粗到20mil5.模拟信号一字型布局6.输出打孔要打在电容后面7.反馈要从电容后
网口差分需要进行对内等长，误差5mil2.差分走线要尽量耦合3.差分走线可以在进行一下优化4.时钟信号需要单独包地处理5.电容尽量靠近管脚摆放6.此处走线尽量与焊盘同宽，拉出来再进行加粗，加粗尽量渐变，不要突然变很大7.中间可以多打过孔进行
跨接器件两边多打点回流地过孔进行回流：电源地跟机壳地之间至少满足2MM间距：从焊盘拉差分走线需要保持耦合，优化下:差分间距都不一样了，没保持耦合，注意修改，重新走差分线：不要出现直角：以上评审报告来源于凡亿教育90天高速PCB特训班作业评审
差分线锯齿状等长不能超过线距的两倍2.差分对内等长误差5mil3.差分出线要尽量耦合4.走线需要优化一下5.RX和TX要创建class，进行等长处理，误差100mil6.时钟信号需要包地处理7.注意除了散热过孔其他的都可以盖油处理8.注意线
1.存在开路，孤岛铜皮没有连接出去。2.芯片中间过孔没有连接出去导致天线报错。3.多处孤岛铜皮和尖岬铜皮。4.电容地网络要和电源一样加宽载流。5.差分焊盘出线尽量耦合6.差分走线不耦合7.时钟信号走线要包地处理8.走线尽量短9.TX、RX没
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