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一、那个让人头疼的辐射问题做开关电源的工程师，大概都遇到过这种情况：样机功能测试一切正常，一上 EMC 测试台，辐射超标了。整改的时候，换磁珠、加屏蔽、贴吸波材料，能想到的办法都用上了，结果呢？有时候有点效果，有时候根本不管用，折腾半天找不
说起来，流水线应该是FPGA/数字电路设计里最常见的优化手段了。入门的时候大家都学过：想提升时钟频率，就把大组合逻辑拆成多级，中间插寄存器。这招确实管用，一用一个准。但问题来了——流水线是不是越深越好？频率跑不上去就无脑加寄存器，这样行不行
上周五晚上十点，群里有个兄弟发了张示波器截图——12V转5V的DCDC，纹波直接飙到120mV。紧接着就是一套"标准操作"：换大电容、加LC滤波、改布局，折腾到凌晨两点，问题依旧。最后换了个探头再测，纹波只有18mV，完全正常。这事儿说出来
早期计算机IO外设喜欢复用寄存器地址的原因是多方面的，包括硬件资源限制、技术实现与兼容性、引脚数量与模块化设计以及软件实现与开销等因素。虽然这种机制增加了软件实现的复杂性，但在当时的技术条件下，它确实是一种经济有效的解决方案。1硬件资源限制地址空间有限早期计算机的地址空间非常有限，尤其是IO空间。随
传感器选型
sensor：传感器，是手机中常用的器件，手机的抬手亮屏、计步器、指南针等功能都依赖传感器。1、目前常用的传感器物理传感器1、acc：加速度计2、gyro：陀螺仪3、als：光线传感器4、ps：距离传感器5、barometer:气压计7、magnetometer：磁力计8、ois：光学防抖其中，ac
做电源设计这么多年，遇到纹波超标的问题，我见过太多工程师第一反应就是加电容。电容加了一圈又一圈，纹波没降多少，成本倒是蹭蹭往上涨。更扎心的是，有时候还整出了谐振尖峰，越整越乱。 上周就有个老哥找我诉苦，说他的板子纹波80mV，客户要求30m
开关电源一上电，示波器探头还没搭上去，辐射超标的数据就先跳出来了。频谱仪上那根怎么也压不下去的包络曲线，让多少工程师熬红了眼。翻开整改报告，密密麻麻写着辐射超标 10dB，整改措施列了一串，加屏蔽线、套磁环、铺地铜——能想到的都试了，效果还
模拟电路最怕什么？噪声。而噪声的源头，往往就是那条看似不起眼的地线。1、地回路地回路的本质是电流在闭合环路中流动时，因地线阻抗产生压降，导致不同接地点电位不等。这个压降会直接叠加到敏感信号上。一个10mV的地电位差，对精密ADC来说就是灾难
你以为走线只是一根导线？在高频下，它是电容、电感和电阻的集合体，相位就是这样被偷偷吃掉了。1、分布参数有多大？FR4板上，走线每厘米约有1pF分布电容，7nH分布电感。一根20厘米的走线，光它自己就有约2pF电容和14nH电感。加上负载电容
凌晨两点，实验室里又只剩下我一个人。频谱仪屏幕上的曲线像过山车一样起伏，150MHz那个尖刺又冒出来了。改了两周，加了三级滤波器，换了两版共模电感，余量还是不够。我把原理图翻来覆去看了七八遍，器件参数没问题，滤波拓扑也对，可就是过不去。后来
