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看了黄老师的教学视频后,从别的pcb文件导出了封装,调用打样之后,发现原来插件的2.54座子不是通孔,然后看了其他插件封装在原来的pcb文件上是插件,但是导出后变成不是插件了,请问怎么解决这个问题。下面是导出前,导出后,以及打样回来的图片

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月光Asuka 2024-03-22 10:14:11

选中了左边的,想放到右边PCB中,一直放不来,交叉模式开了,文件也都在工程下面,而且这个工程文件里其他原理图的器件都可以摆放到右图里,就这个原理图不行,这是为什么啊?我百度也没查到,求大佬们解答。感谢感谢!!!

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在QuartusII下进行编译和仿真的时候,会出现一堆warning,有的可以忽略,有的却需要注意,虽然按F1可以了解关于该警告的帮助,但有时候帮助解释的仍然不清楚,大家群策群力,把自己知道和了解的一些关于警告的问题都说出来讨论一下,免得后来的人走弯路. 下面是我收集整理的一些,有些是自己的经验,

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AD新版本画实心区域的时候 底部不是透明的 铺铜的时候看不到下面的走线 老版本是透明的 可以看到底部走线这样铺铜更方便 这个应该怎么设置

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@ 2025-02-26 21:04:08

请问allegro中走线等长设计,是看下面那个参数?

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从0到1 2025-10-25 15:46:45

本次直播我们将以cadence allegro 17.4来详细讲解一个GD32 ARM开发板整个开发过程,从原理图设计、PCB 3D封装创建、到PCB布局布线整个过程,由于时间比较长, 本次直播将分为8期来进行讲解,具体时间安排请查看下面的时间直播排期表。

基于Cadence 17.4的GD32 ARM硬件设计