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去耦电容紧贴FPGA，电源噪声为何仍超标？电容贴得近，只缩短了板面距离；电流若要绕远路穿过过孔和平面，安装电感仍会挡住高频补能 FPGA瞬态电流沿电源焊球、平面、过孔、去耦电容和地返回形成闭环。电容到封装的直线距离很短，不代表闭环面积小；端
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MOS换成更低导通电阻的型号，电源效率为什么没明显提升？RDS(on)降低，只能直接减少导通损耗。开关电源里还要看栅极电荷、输出电容、反向恢复、开关频率和驱动能力；如果开关损耗占比更高，换一颗低阻MOS，整机效率未必有明显变化。做电源优化时
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