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机壳地以及电源地没有正片铺铜处理也没有负片分割处理,注意地是需要处理的:
变压器上除了差分信号,其他的加粗20MIL走线:
电源层也并未处理电源 :
TX RX信号之间用GND走线隔开:
RX TX没有创建等长组进行等长:
差分对内等长误差为5MIL:
很多电子初学者在使用Cadence Allegro进行Layout设计时,会有一些mipi或lvds等差分走线,在走线时可能为了匹配线序,导致信号网络的走线是交叉,这样做不仅费时费力,还会影响信号质量,那么如何将这些器件的引脚交换过来?如图
答:我们在PCB中进行布线的时候,高速信号先都是需要做阻抗设计的,做阻抗设计必须要有完整的参考平面,为了保证阻抗的连续性,高速信号尽量不要跨分割,所以我们在设计过程中都需要进行检查,具体操作步骤如下所示:
答:当PCB设计完成以后,需要输出相关的光绘文件,在这之前,我们需要提取钻孔的信息,我们这里讲解一下,如何去查看PCB文件上的钻孔文件信息,具体操作如下所示:
答:平面分割设计,是PCB设计中一项非常重要的事项,我们在处理完PCB的走线以后,会 处理电源还有地,地平面一般是完整的,一般不需要分割,电源平面一般会分割几个电流比较大电源,我们这里讲述一下如何对电源平面进行分割,具体操作如下:
此处一层连通无需打孔2.注意过孔不要上焊盘3.此处为电源输入,打孔应该打在滤波电容的前面,并且走线加粗4.pcb上还存在飞线5.注意打孔尽量对齐处理以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接
一枚专注于高速硬件设计的年轻工程师,每天都在设计软件中苦逼拉线进行时。
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