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我们平时测试S11是在板边,如果箭头处板边和第一个元件之间传输线很长的话,测试出来偏差大不大? 如果在板上调匹配是不是要把参考面校准到元件附近,不这样操作误差大不大?我看有些人板上会留TRL校准的元件,这样有是不是为了校准到芯片附近调匹配更准确一点?
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问答
DDR3等长
一块DDR3的数据线，数据线的长度差在50mil内，是指所有的数据线都在同一个50mil误差内，还是LD和UD各自在50mil误差内？比如LD在1000mil~1050mil，UD在2000~2050mil内，这种布线可行吗？
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传输速度越快，误差要求越小？DDR2的数据线等长误差范围为±25mil，那DDR3的数据线等长误差范围是多少呢？
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在高速设计中，基于时序的考虑通常要对信号做线长匹配。对于Allegro PCB设计者来说，我们在等长的时候经常会提到X-NET，利用X-NET功能我们能够很快的计算多点拓扑结构等长长度，并且还能够计算数据组等长误差，很是方便，但是我发现在给很多学员教学的过程中，很多人不清楚这个功能的使用，那么我们这次抽时间弄成一个专题来详细的给大家讲解一下。
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