找到 “等长” 相关内容 条
  • 全部
  • 默认排序

电源模块反馈电路错误,r15接入反馈电源到r14在到5号管脚。2.晶振布局布线错误3.typec差分对内误差控制5mil以内,尽量避免出现不耦合4.TF卡所有信号线要整组 ,做等长处理以时钟线为目标,目标控制在300mil以内。

立创EDA梁山派-郭付根第二次作业评审报告

1.电源输入的滤波电容应该靠近输入管脚(4脚)放置2.差分线处理不当,锯齿状等长,凸起高度不得超过线距的两倍3.差分要尽量耦合出线,后期自己调整一下走线路劲4.此处电源出线载流瓶颈,电流计算都是以最窄处铜皮计算的5.线宽突变,确认一下具体线

立创EDA梁山派-周嘉杰作业评审报告

差分线处理不当,锯齿状等长,凸起高度不得超过线距的两倍2.电源输入的滤波电容应该靠近输入管脚(4脚)放置3.反馈从最后一个电容滤波电容取样,走一根10mil的线即可4.时钟包地需要间隔150mil-200mil打上一个地过孔5.线宽突变,确

立创EDA梁山派-申健作业评审报告

晶振布局、布线错误,晶振的一对线要走成类差分的形式, 线尽量短如下图。typec的LCD_R4、LCD_R5要建立差分对走差分阻抗控制90欧姆做对内等长,换层需要靠近过孔打回流地过孔,D7、D8应该尽量靠近typec管脚放置。TF卡所有信号

立创EDA梁山派-郭付根作业评审报告

USB的差分信号需要进行对内等长等长误差为5mil2.晶振走线需要走类差分处理3.此处是用菊花链的方式进行等长,建议使用创建焊盘对组进行分段等长(U1-U2,U2-FPC1)4.电源输入的滤波电容应该靠近输入管脚(4脚)放置5.电源输出部

立创EDA梁山派-阿泰作业评审报告

差分线这里需要调整走线尽量不要有直角锐角这里是输出走线应该加粗处理最好铺铜处理。SD卡所有信号线要做等长处理,以时钟线为目标,目标控制在300mil以内。这个差分在这里另一根就断了,不耦合对内也不等长。很多的线间距都不满足3w原则自己调整一

立创EDA梁山派-苏靖楠作业评审报告

时钟信号包地需要在地线上间隔150mil-200mil打上一个地过孔2.差分线处理不当,锯齿状等长,凸起高度不得超过线距的两倍3.器件摆放注意对齐处理4.焊盘出线不规范,焊盘中心出线至外部才能拐线处理,避免生产出现虚焊;地网络打一个孔即可,

立创EDA梁山派-MZMMX作业评审报告

1.电源输入的滤波电容应该靠近输入管脚(4脚)放置2.走线尽量不要从器件中间穿,自己调整一下走线路劲3.此处出线载流瓶颈,载流计算都是以铜皮在窄处进行计算4.差分线处理不当,锯齿状等长,凸起高度不得超过线距的两倍5.器件摆放尽量对齐处理6.

立创EDA梁山派-JIA作业评审报告

晶振下面尽量不要走线2.线宽突变,确认一下具体线宽,尽量保持统一3.电源输入的滤波电容应该靠近输入管脚(4脚)放置4.差分线处理不当,锯齿状等长,凸起高度不得超过线距的两倍5.注意等长线之间需要满足3W规则6.走线尽量不要有直角,此处需要优

立创EDA梁山派-Attention作业评审报告

晶振下面尽量不要走线2.晶振需要走类差分形式3.电源的输入输出需要铺铜处理,铺铜宽度需要满足电源电流大小4.差分线处理不当,锯齿状等长,凸起高度不得超过线距的两倍5.时钟包地的地线上需要间隔150mil-200mil打上一个过孔6.焊盘出线

立创EDA梁山派-39_43作业评审报告