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差分线这里需要调整走线尽量不要有直角锐角
这里是输出走线应该加粗处理最好铺铜处理。
SD卡所有信号线要做等长处理,以时钟线为目标,目标控制在300mil以内。
这个差分在这里另一根就断了,不耦合对内也不等长。
很多的线间距都不满足3w原则自己调整一下
其他类设计软件通常是通过网格来对齐元件、过孔、走线的,嘉立创EDA提供非常方便的对齐功能,如图1所示,可以对选中的元件、过孔、走线等元素实行向上对齐、向下对齐、向左对齐、向右对齐、水平等间距对齐、垂直等间距对齐。1、执行菜单命令“布局-对齐
一、元件符号概述如图1所示,元件符号是元件在原理图中的表现形式,主要由元件边框、管脚(包括管脚符号和管脚名称)、元件名称及说明组成,通过放置的管脚来建立电气连接关系。元件符号中管脚序号是和电子元件实物的管脚一一对应的。在创建元件的时候,图形
1.电源输入的滤波电容应该靠近输入管脚(4脚)放置2.差分线处理不当,锯齿状等长,凸起高度不得超过线距的两倍3.差分要尽量耦合出线,后期自己调整一下走线路劲4.此处电源出线载流瓶颈,电流计算都是以最窄处铜皮计算的5.线宽突变,确认一下具体线
差分线处理不当,锯齿状等长,凸起高度不得超过线距的两倍2.器件摆放尽量对齐处理3.晶振走线需要走类差分处理4.电源输入的滤波电容应该靠近输入管脚(4脚)放置5.此处在一层走线即可,建议铺铜处理6.时钟包地需要在地上间隔150mil-200m
时钟信号包地需要在地线上间隔150mil-200mil打上一个地过孔2.差分线处理不当,锯齿状等长,凸起高度不得超过线距的两倍3.器件摆放注意对齐处理4.焊盘出线不规范,焊盘中心出线至外部才能拐线处理,避免生产出现虚焊;地网络打一个孔即可,
哥只是个传说,不要迷恋哥!
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