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做EMC整改这么久，有个现象挺有意思。很多工程师能把电路设计得很漂亮，原理图、PCB都规规矩矩。但一到EMC测试不过，就开始盲目加器件：共模电感、磁珠、电容一通乱加。效果呢？有时候有用，有时候没用，完全是碰运气。为什么？因为很多人根本没搞清
很多工程师把包地当作时钟布线的万能药，但包地没做好，不仅没用，还可能让EMI更糟糕。1、包地的本质是什么？包地是锦上添花，不是雪中送炭。它的核心作用是提供低阻抗回流路径和电磁屏蔽。但这一切的前提是——你得有一个完整的地平面。没有完整地平面，
纹波超标，换大电容没用，减小电感也没用。真正的罪魁祸首，往往藏在ESR这个参数里。1、纹波的两大来源DCDC输出纹波由两部分组成：电容充放电引起的电压波动，和ESR上的压降。很多人只关注容值，却忽略了ESR产生的压降直接叠加在纹波上。公式很
TVS管装了，保险丝也加了，热插拔照样烧接口。不是保护不够，是保护用错了地方。1、TVS为什么没用？TVS管只防高压浪涌，不防大电流。热插拔烧接口的元凶，不是电压高，而是电流大。TVS管响应速度是纳秒级，但热插拔时的持续短路电流，它扛不住几
电阻加大了，波形还是乱跳。问题不在电阻，而在你看不见的地方。1、振荡的本质驱动走线的寄生电感L，与MOS管栅极寄生电容C，构成LC谐振回路。公式很直白：当驱动电阻 R < 2√(L/C) 时，电路处于欠阻尼状态，振荡必然发生。你调电阻没用，
ESD测试一碰就复位，TVS明明焊上去了，照样扛不住。问题出在哪？十有八九，不是器件选错了，是板子 layout 拖了后腿。1、TVS选对了，布局废了TVS响应速度是ps级，比压敏电阻快得多，选型本身通常没问题。但ESD脉冲上升时间仅0.7
传导发射超标，第一反应就是换个更大的共模电感。结果一测，更差了。问题出在哪？不是电感没用，是你只看了一面。1、漏感才是隐形杀手共模电感对共模信号是高墙，对差模信号是坦途。但"坦途"不等于零阻抗。电感量越大，漏感也越大。漏感通常是共模电感量的
时钟走线两侧加了地线包围，本想屏蔽干扰，结果辐射测试反而超标。不是地线没用，是你把它变成了天线。1、包围地变成了环形天线时钟线两侧各跑一根地线，如果两端都接地，恭喜，你造了一个环路天线。时钟信号是方波，高频谐波丰富。这些谐波电流在环路中流动
焊接维修时经常遇到烙铁头怎么蹭都挂不住锡，蘸再多松香也粘不上，反复打磨也没用。不用直接换新烙铁头，按分层步骤排查，90%以上的情况都能快速恢复上锡能力。1. 先清表面氧化层把烙铁头升温到300℃左右，用拧干水的耐高温清洁海绵反复擦拭头部。顽
焊完0402、0603这类贴片元件，经常出现两端一高一低、本体歪扭的情况，反复调整镊子位置也没用。问题不全是对位不准，很多隐性细节没处理好才导致元件被锡面张力顶歪。1. 两侧焊盘锡量不均两个焊盘上的预镀锡厚度差超过0.1mm，多锡一侧的表面
