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注意电源地跟机壳地之间满足至少2MM间距:
器件注意放置完全,并且放置完成之后走线连接:
把没有设计的器件布局布线设计下。
变压器除了差分信号,其他信号也要走线连接完全:
还存在多处飞线,存在信号没有连接完全:
等长线之间需要满足3W间距:
注意等长还存在误差报错:
晶振靠近管脚放置,尽量少打孔换层,包地处理2.差分包地地线上需要多打地过孔3.器件摆放尽量对齐处理4.注意过孔不要上焊盘后期自己检查一下过孔上焊盘和过孔重叠5.信号包地应该用地网络,不要用电源6.SD卡组内误差不能超过400mil7.注意走
答:打开Allegro软件,点开Analyze菜单栏,如图5-30所示,这是仿真分析菜单栏下一些命令行。下面我们对Analyze菜单栏下面的一些常用命令进行简单的介绍,具体知道是如何进行操作的,具体如下:
答:当PCB设计完成之后呢,在调整元器件的参考编号时候,会发现元器件的参考编号非常乱,原理图在设计时没有进行统一的编号处理,为了管理方便,可以在PCB中对元器件的参考编号进行重新排列,具体操作如下所示:
个别器件注意整体对齐:注意等长线之间需要满足3W间距原则:没满足的都自己优化下。数据线组内也需要满足3W:差分对内等长误差为5MIL:其他的没什么问题。以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问
答:我们在进行PCB设计的时候,都是在PCB布局完成之后,在PCB中进行规则设置,但是很多原理图工程师喜欢在原理图中设置规则,这样导入网表之后,PCB加入的规则就会被冲掉,我们这里讲解一下,如何不将原理图的中所添加的规则导入到PCB中,具体操作的步骤如下所示:
一枚专注于高速硬件设计的年轻工程师,每天都在设计软件中苦逼拉线进行时。
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