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全能18期one piece-第一次作业 DCDC模块的PCB设计作业评审

2023-04-04 17:19

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电感背面没有挖空处理

这里gnd过孔不满足载流，输入有多少过孔输出也要有同样数量的过孔

反馈线可以不用加粗处理的

以上评审报告来源于凡亿教育90天高速PCB特训班作业评审

如需了解PCB特训班课程可以访问链接或扫码联系助教：

https://item.taobao.com/item.htm?spm=a1z10.1-c-s.w21136784-21870440400.21.5c7b5284NnAAq6&id=601258730169

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差分对内不等长，误差控制在+-5milrx和tx也没有做等长处理变压器旁边的线处理差分都要大于20milrxtx之间要用根gnd间隔开来时钟要包地处理以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链

2023-09-25 17:26

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答：在做PCB设计时，有时结构上会对局部的器件布局有高度要求，不能将超过高度限制的器件放到限高区，否则会导致PCB装配问题。这个高度信息我们可以在做PCB封装时进行设置，设置好了就可以在设计时查看高度信息，辅助我们进行PCB设计。第一步，打开一个PCB封装，将Package Geometry-Place_Bound_top层显示出来，如图4-70所示， 图4-70  显示元器件占地面积示意图第二步，点击Setup-Areas-Package Height选项，如图4-71所示

2021-02-23 15:11

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个别线宽和其他走线不一致尽量避免小器件焊盘打孔等长绕线注意角度，部分绕线实际生产是直角以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教：https://item.taobao.com

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答：在Allegro软件中，所铺的铜皮全部都是动态铜皮，在进行Etch显示的时候，包括走线、铜皮都会显示，在前面的问答中我们讲解了如何将铜皮全隐藏不显示，但是，这样不方便走线设计，走线时不清楚哪一块有铜皮，这里我们讲解一下，如何设置铜皮不显示，但是在PCB中还是显示铜皮的边框，具体操作如下所示：

2021-03-27 15:07

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答：我们在使用Allegro软件进行PCB设计时，铺的铜皮都是动态或者是静态的铜皮，当打开Etch的时候，所有的走线跟铜皮都是同时显示的，如图5-130所示，在Allegro软件中是否可以隐藏铜皮呢，只显示走线呢，答案是可以的，具体操作如下：

2021-03-12 15:35

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