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电源EMI滤波器的设计方法及常用技巧

电磁骚扰的传播方式，大致可以分成两种：一种是传导干扰，另一种是辐射干扰。用于改善电路噪声容限的板上型噪声滤波器可设计在9kHz～1780MHz频率范围内(根据电磁兼容有关标准)某一频段下工作。一般来说：噪声频率低段表现为传导干扰(骚扰)，噪

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EMI滤波器电源

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IC设计的信号完整性问题分析

以前信号完整性（SI）问题仅仅出现在高速电路板，但随着电子器件的特征尺寸越来越小元件的供电电压、噪声容限也开始下降，耦合电容增加，这些都导致了在IC系统中会出现信号完整性问题，那么该如何处理IC设计的信号完整性问题？一般来说，影响信号完整性

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IC设计信号完整性SI

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工程师如何在示波器中设置眼图？

在高速数字电路调试中，很多工程师会利用眼图分析，评估其信号完整性。通过示波器捕获的眼图，工程师可直观判断码间串扰、噪声容限等关键指标。本文将以泰克等主流示波器，谈谈其眼图设置。1、硬件连接与基础设置①探头配置使用1GHz以上带宽的差分探头，

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示波器眼图信号完整性

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眼图设置中会遇见哪些异常图谱问题？

在高速数字电路调试中，眼图分析是评估信号完整性的核心手段。通过示波器捕获的眼图，工程师可直观判断码间串扰、噪声容限等关键指标。1、"眯眼"现象特征：眼高<200mV，交叉点模糊诱因：阻抗不连续导致的反射，或电源噪声耦合解决方案：检查过孔残桩

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眼图示波器测试测量

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技术资讯 | CMOS 噪声容限值

在描述高速运行的数字系统时，噪声容限是最重要的参数之一。通常情况下，噪声容限定义了 I/O 引脚上或接口中可接受的噪声水平。在数字电子技术领域，噪声容限是指 I/O 引脚上出现但不会导致接收逻辑状态出错的噪声水平。这个值在时域中经常调用，用于测量比特误码率。如果您正在设计高速 PCB 并需要执行串扰

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CMOS噪声容限