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差分走线要注意耦合出线
2.时钟信号包地需要再地线上打上地过孔
3.差分走线不满足间距规则
4.网口差分需要进行对内等长,误差5mil
5.小块孤铜后期可以挖掉
以上评审报告来源于凡亿教育90天高速PCB特训班作业评审
如需了解PCB特训班课程可以访问链接或扫码联系助教:
https://item.taobao.com/item.htm?spm=a1z10.1-c-s.w21136784-21870440400.21.5c7b5284NnAAq6&id=601258730169
注意走线规范,不允许直角走线,并且地网络尽量铺铜处理:注意 铜皮绘制不要有尖角:器件注意整体中心对齐:铺铜的铜皮宽度尽量均匀:多余的过孔删掉:焊盘出线不能直接拉出,需要拉出焊盘之后再去拐线处理:整板的走线跟铜皮以及布局都要优化。以上评审报告
pcb上存在短路2.滤波电容靠近管脚放置,走线加粗3.晶振下面尽量不要走线4.此处电源不满足载流5.变压器所有层挖空6.变压器除差分信号外,其他信号都需要加粗到20mil7.差分线对内等长处理不当,锯齿状等长凸起高度不能超过线距的两倍8.走
差分等长不耦合,差分对间等长可以用差分等长命令上面也要包地处理RJ45:提交作业的时候铺一下铜走线不要从电阻中间穿过以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:https://
Altium原理图系统参数设置-Graphical Editing选项卡Graphical Editing选项卡包含原理图图形设计的相关信息。如图2-25所示,进入Graphical Editing选项卡的设置界面,对以下4个选项进行推荐设
在设计PCB的时候,为了满足各项设计要求的原因,我们需要设置很多的约束规则,然后设计完成之后,去进行DRC检查。DRC检查就是检查我们的PCB设计是否满足所设置的规则,常见的DRC检查有开路,短路,间距等等规则约束。
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