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走线未完全连接上
TX等长误差100mil,时钟信号也要进行等长
走线不要有直角
其他没什么问题
以上评审报告来源于凡亿教育90天高速PCB特训班作业评审
如需了解PCB特训班课程可以访问链接或扫码联系助教:
https://item.taobao.com/item.htm?spm=a1z10.1-c-s.w21136784-21870440400.21.5c7b5284NnAAq6&id=601258730169
链接:https://pan.baidu.com/s/1GqS6H8AjXde7zLV0fOQ-WQ 提取码:kp7c
对于一些pcb设计规则可以通用的板子,AD提供了“设计规则导入和导出“的功能,这样就避免设计规则的重复设置,提高了设计效率。
AD如何设置丝印到阻焊的间距,并分析丝印重叠阻焊的影响
芯片出线不要从管脚中间出差分对内不等长,误差应该控制在+-5mil变压器下面所有层都要挖空处理这个差分出线不耦合这两个电阻应该调换一下位置这个VGA布局的时候要采用一字形或者L形布局,RGB信号之间的安全距离一般设置20mil,需要包地处理
还存在网络并未连接完全,自己后期铺地铜进行连接:注意调整下器件位号丝印,不要覆盖在焊盘上或者是重叠,直接就近放在器件旁边整齐排列即可:过孔散热焊盘上的开窗即可,其他的盖油处理:铺铜注意不要有这种尖角:电感内部注意挖空处理:自己看下过孔都没网
pcb行业大佬
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