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走线未完全连接上
TX等长误差100mil,时钟信号也要进行等长
走线不要有直角
其他没什么问题
以上评审报告来源于凡亿教育90天高速PCB特训班作业评审
如需了解PCB特训班课程可以访问链接或扫码联系助教:
https://item.taobao.com/item.htm?spm=a1z10.1-c-s.w21136784-21870440400.21.5c7b5284NnAAq6&id=601258730169
1.小的滤波电容应该靠近管脚放置2.所有层挖空处理,负片层需要单独放置一个铺铜挖空3.存在开路4.器件摆放尽量不要太近,建议最少1.5mm以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系
跨接器件旁边尽量多打地过孔,间距最少1mm,有器件的地方可以不满足2.地网络直接就近打孔,走线不要从小器件中间穿,容易造成短路3.等长存在误差报错4.注意等长线之间需要满足3W间距5.注意一下此处是否满足载流6.器件摆放不要干涉一脚标识7.
在将原理图通过网表导入或者直接导入的方式导入到PCB中,我们有时候可以看到同封装的焊盘在进行绿色报错,一般情况下是多管脚的IC元器件报错
散热孔要两面开窗处理rx等长误差控制在100以内差分这里优化一下以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:https://item.taobao.com/item.htm?s
我们在进行元件库与原理图设计的时候,有时候想去更改后面背景的格点的大小。但是又不知道在哪里设置的呢?以及它的推荐值设置又是什么呢?
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