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硬件工程师面试：ADC参考电压为什么影响采样精度？去耦和PCB布局怎么做？
ADC采样结果不仅取决于输入信号，也取决于参考电压。参考电压有噪声、漂移或瞬态下陷时，转换结果会出现比例误差或码值抖动，所以VREF不能简单当成一根普通电源线处理。
硬件工程师面试：ADC参考电压为什么影响采样精度？去耦和PCB布局怎么做？
面试回答
ADC把输入电压与参考电压进行比较并量化，参考电压决定转换量程和比例基准。VREF的精度、温漂、噪声、瞬态响应以及参考引脚的布局，都会影响ADC的实际测量结果。设计时应先看芯片数据手册对参考源驱动能力和去耦电容的要求，再决定是否需要外部基准、缓冲器和专用滤波网络。
01参考电压具体影响什么
理想情况下，N位ADC的量化步进约为VREF/2^N。以12位、3.3V参考为例，1 LSB约为0.806mV；参考电压的变化会影响整个转换比例。
参考源的初始精度和温漂影响绝对测量误差；宽带噪声和开关噪声会表现为采样码抖动；负载瞬态响应不足时，采样过程中参考端也可能出现短时扰动。
02去耦电容不是越大越好
先确认ADC参考引脚是高阻输入还是存在动态电流需求，是否内置缓冲，以及数据手册推荐的电容值、介质和ESR范围。
参考源本身可能对容性负载有稳定性要求。随意并联很大的电容，可能导致参考芯片启动变慢或环路稳定性变差。
参考电容应尽量靠近对应引脚，连接短、回路小；如果使用缓冲器，要同时检查其驱动能力、输出稳定性和负载条件。
03PCB布局如何降低干扰
参考电压走线尽量短且远离开关节点、时钟和大电流回路；模拟地与数字回流的处理要遵循芯片推荐布局，避免让数字脉冲电流穿过敏感参考回路。
必要时对参考电源做单独滤波，并在实际板上测量VREF纹波、启动稳定时间和ADC码值分布，而不是只看原理图。
只盯着参考芯片标称精度，却忽略它能否驱动ADC参考端的动态负载；或者不看数据手册就给VREF并一个很大的电容。
如果万用表测得VREF很稳定，但ADC采样码仍然抖动，你还会检查哪些因素？
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