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连接器边上留了空位,为何装配仍会卡?二维间距看着够,三维装配包络仍可能直接撞上去 压接连接器的禁布不是围着焊盘画一圈。连接器本体、配合护套、插拔方向、压接治具和装配公差会共同扫过一块三维空间;任何器件进入这块空间,都可能在样机装配时卡住。P

连接器边上留了空位,为何装配仍会卡?

AD18.1.6版本,PCB图上,在Keep-out layer 层上不能画线,不知什么原因?有谁能画吗?一画线就跳到Drill Drawing层。而且奇怪的是,就算画好了一段其它层的线,双击也不能改到Keep-out layer 层(在层选择里面压根就没有这上层)。

在AD17中keep outlayer层自定义板框画线时,选择Place Line命令,却自动切换到了Drill Drawing 层,为什么会出现这种情况?请问应如何解决?谢谢!

AD19 pcb 如何设置一个净空区域禁止布线局域

Modified Polygon: Polygon Not Repour After Edit (GND) on Keep-Out Layer这个错误什么原因Modified Polygon: Polygon Not Repour After Edit (GND) on Keep-Out Layer

在AD16里,这个 禁置区 是什么意思,为什么勾上了,打样板子的话供应商说缺少外框呢?

禁布区 里要放一个polygon,怎么弄?绿框里的那个polygon,因为画了挖空,灌不出来。。。

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