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1.多处飞线没有链接
2.此处是兼容设计,上下小器件应叠到中间器件焊盘上,以保证差分和电阻的连接不受影响
3.差分对内等长不符合规范
以上评审报告来源于凡亿教育90天高速PCB特训班作业评审
如需了解PCB特训班课程可以访问链接或扫码联系助教:
https://item.taobao.com/item.htm?spm=a1z10.1-c-s.w21136784-21870440400.21.5c7b5284NnAAq6&id=601258730169
AD19出现[Error] XXX.Sch Compiler Sheet-Entry XX not matched to Port at Xmil,Ymil问题的解决方法
电感挖空所在层需要重新铺铜处理2.输出打孔尽量打在最后一个滤波电容后面3.反馈信号需要走10mil4.电感下面尽量不要放置器件和走线,后期自己调整一下器件摆放位置5.器件摆放尽量中心对其处理,更美观以上评审报告来源于凡亿教育90天高速PCB
在编写设计规则时,我们经常会用Query语句来详细地限定设计规则的范围。如何准确地编写Query语句,并在编写完成之后检查Query语句的范围是否正确呢?下面详细地说明一下。
差分从过孔拉出也需要耦合走线处理:注意差分等长规范,gap需要大于等于3W的:其他的没什么问题。以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:https://item.taoba
常用VIEW视图快捷命令:命令快捷键功能说明适合文件VD当设计图页不在设计目视范围内,可快速归位适合所有对象VF对整个图纸文档进行归位放大Page up以鼠标指针为中心进行放大缩小Page down以鼠标指针为中心进行缩小选中的对象VE可以
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