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在绘制层次原理图后进行编译时，有时会遇见弹出报错“XXX.Sch Compiler Sheet-Entry XX not matched to port”的情况，那么为什么会出现此报错，以及应该如何解决呢？
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在原理图中给元器件添加封装时，替换封装是经常会用到的操作，如果要替换所有电容的封装，一个个更改会比较繁琐，那么怎么在原理图中批量替换封装呢?
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在绘制原理图时，有时会遇到元器件管脚放置错误需要更改管脚位置，或者管脚名错误需要更改管脚信息的情况，一般情况可以直接去与原理图库进行更改，这里介绍一下如何在原理图中移动元器件管脚以及更改管脚名称？
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在绘制原理图时，为了使原理图看起来更加简洁美观，对于像类似IC类型器件一般只显示位号，会隐藏其comment值，对于电容这类型器件，一般会隐藏器件的管脚号，那么在原理图中如何隐藏位号或者管脚号呢？
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