出现的原因：在原理图库中绘制了一个带有多个part的封装（HI3518EV200），但未设置PCB Footprint。在dsn空间的一个原理图内，通过EdIT Part修改改器件的PCB Footprint时候，会因为dsn空间内的元器件封装与sch_lib.olb元件库的封装不同，导致会把修改后的封装保存到dsn空间内的Design Cache，并将名字修改为HI3518EV200_x。

​区域规则设置是针对某个区域来设置规则，为了满足设计阻抗和工艺能力的要求，需要对个别区域设置特殊规则的线宽走线或者间距或者过孔大小等，这个时候可以对这个区域进行特殊规则设置，常用于各类不同pITch间距的BGA。

AD差分走线时出现Second differential pair primITive could not be found报错

Cadence allegro学习笔记第一节 启动与板框的制作1、启动操作启动PCB EdITor图标，弹出对话框后选择Allegro PCB Designer后择OK进入界面。 选择File文件菜单选择New新建弹出下面对话框。设置

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