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此处可以不用打孔
2.反馈信号需要走10mil以上
3.此处为电源输入,走线需要加粗,过孔要打在滤波电容前面
4.走线尽量不要从电阻电容中间穿
5.散热过孔需要开窗处理
以上评审报告来源于凡亿教育90天高速PCB特训班作业评审
如需了解PCB特训班课程可以访问链接或扫码联系助教:
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电源铜皮尽量铺工整一点,并且加宽铜皮宽度满足载流大小:此电源输入主干道通道比较长,建议是否可以调整布局,缩短主干道路径:输出主干道是否可以加宽铜皮宽度:反馈信号直接走线连接,不要打孔连接电源平面:5V电源有这种瓶颈的地方,自己优化加宽:模拟
AD19敷铜脚本文件导入与敷铜操作
SATA:可以直接把差分规则里面的耦合度设置大一点就不会报错了:此处差分直接走顶层不用扇孔了:MIPI:注意差分组跟组等长误差为10MIL:此对差分对内等长误差是5MIL:以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PC
至于USB,SATA,PCIE等串行信号,并没有上述并行总线的时钟概念,其时钟是隐含在串行数据中的。数据发送方时钟包含在数据中发出,数据接收方通过接受到的数据恢复出时钟信号。这类串行总线没有上述并行总线等长布线的概念。但因为这些串行信号都采用差分信号,为了保证差分信号的信号质量,对差分信号对的布线一般会要求等长且按总线规范的要求进行阻抗匹配的控制
在Altium Designer(AD)中,很多工程师通过使用Design Rule Check(DRC,常用于检查PCB设计是否符合设计规范和要求)功能来检查PCB设计的完成度,但很多小白不太熟悉怎么去使用DRC,下面来看看它的用法。1、
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