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注意差分凸起高度不能超过线距的两倍
2.差分走线需要优化一下
3.时钟信号尽量包地处理
4.电容尽量靠近管脚均匀摆放
5.差分出线要尽量耦合,后期自己优化一下
6.存在多处开路
后期自己在顶底层铺上电源和地铜皮
7.变压器需要挖空所有层处理
注意布局的时候器件整体中心对齐:底层器件也注意对齐:打孔也需要对齐:5V电源走线加粗或者铺铜连接好:铺铜连接之后不需要再走线连接了:注意电感内部当前层需要挖空,放置一个keepout区域:过孔都没有对齐等间距:LDO电路的电源信号也需要加粗
锯齿状等长不能超过线距的两倍2.器件摆放尽量不要挡住一脚标识3.差分对内等长误差5mil4.存在多余的走线以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:https://item.
答:我们在进行设计的时候,如果是在同一层进行铺铜处理,当出现有两个或者两个以上的铜皮重叠的情况出现,如图6-106所示,A铜皮与B铜皮重叠在一起,A铜皮的优先级要高于B铜皮,所以A铜皮是保持原来的形状的,B铜皮会自动避让一块。
1.电源信号多余打孔,电源在其他层没有铺铜不要打孔。以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:https://item.taobao.com/item.htm?spm=a1z
过孔不要打在焊盘上这里还有飞线未连接这里gnd要铺铜这里的走线要加粗以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:https://item.taobao.com/item.htm
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