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上周五晚上十点，我蹲在实验室盯着一块刚回流的Buck电路板，示波器上那该死的纹波怎么都压不下去。12V输入，5V输出，理论上稳稳当当的电源，纹波愣是飙到了80mV。
我第一反应是电容不够。于是一通操作猛如虎，又并上去3个0.1μF、2个10μF。焊接的时候手都在抖，心想这次总该行了吧。
结果你猜怎么着？纹波还是80mV，一动不动。
旁边老王探头过来瞄了一眼，说了句让我当场破防的话："你那几个电容全挤在板子边缘，IC引脚到电容的走线快赶上我老家到县城了，这能有用才怪。"
我当时不服气，理论上一堆电容并联，容值往那儿一加，阻抗不就下来了吗？
后来仔细查了一遍，问题还真是出在电容的位置上。
第一个坑：以为电容数量能解决一切说实话，我见过太多人跟我一样，拿到板子测出纹波大，第一反应就是"多加几个电容"。这种思路不能说完全错，但就像你以为灭火器越多越好，结果全堆在消防通道里，真着火了根本够不着。
电容并联确实能降低阻抗，但前提是你得让电容"看得见"IC的电流需求。IC在开关瞬间需要的电流是纳秒级的，这个电流必须从电容里直接抽出来，而不是绕半个板子再兜过来。
我后来查了资料才知道，一个0.1μF的陶瓷电容，在100MHz频率下，1mm的走线就能贡献约0.8nH的寄生电感。这0.8nH在100MHz时对应的感抗大概是0.5Ω。听起来不多？当你需要IC在1ns内抽到100mA电流时，这个0.5Ω就能让电源电压跌掉50mV。
所以关键点来了：电容离IC越近，寄生电感越小，高频去耦效果越好。
第二个坑：以为只要靠近就行，顺序无所谓后来我学乖了，把电容挪到了IC引脚旁边。但一测，纹波还是只降了一点点，从80mV变成60mV，远远没达到预期。
问题出在哪儿？我仔细看了好几遍布局，发现大容值的10μF电容反而放得比小容值的0.1μF更靠近IC。
这就涉及到一个很多人忽略的原则：不同容值的电容，摆放顺序有讲究。
小容值电容（0.01μF~0.1μF）的自谐振频率高，主要负责抑制高频噪声（100MHz以上），所以必须最靠近IC引脚。大容值电容（10μF~100μF）负责低频能量储备，可以放得稍远一点。
我查了资料，有个图示得很清楚：电容应该按"从IC往外，容值从小到大"的顺序排列。就像接力赛，小电容跑第一棒处理最快的噪声，大电容在后面补能量。如果顺序搞反了，高频噪声还没被小电容拦截，就已经被大电容那条"远路"给漏过去了。
图1：小容值电容靠内、大容值电容靠外的正确顺序
第三个坑：以为过孔位置不影响大局你以为电容放对了位置就完事了？Too young。我之前还有一个问题：过孔打在电容焊盘旁边，走线绕了一大圈才到IC引脚。
后来看到一篇技术文章才明白，过孔的位置同样关键。文章里提到，去耦电容的过孔应该尽量靠近焊盘，最好使用"过孔紧邻焊盘"的布局。如果过孔离焊盘太远，或者走线太细太长，环路面积就会变大，寄生电感增加，高频去耦效果打折扣。
有个数据很直观：相同条件下，过孔间距从5mm缩短到1mm，环路电感可以降低30%以上。
还有个进阶技巧：电源和地的过孔要成对出现，且尽量靠近。两个过孔的电流方向相反，磁场会部分抵消，环路电感又可以降低一截。这个技巧在我后来调一个FPGA板子的时候用过，效果确实明显。
正确做法：位置、顺序、过孔，一个都不能少说这么多，总结一下正确的去耦电容布局该怎么做：
第一，就近放置。 电容焊盘到IC引脚的距离，控制在2mm以内，越近越好。实测过，这个距离超过5mm，高频去耦效果基本可以忽略。
第二，讲究顺序。 从IC往外依次是：小容量电容（0.01~0.1μF）→ 中容量（1~10μF）→ 大容量（10~100μF）。小电容守住第一道防线，大电容在后方做能量缓冲。
第三，优化过孔。 过孔紧邻焊盘，电源和地过孔成对靠近。必要时可以用多个过孔并联，进一步降低阻抗。
第四，地平面连接要可靠。 电容的GND端必须直接连到低阻抗地平面，不要用长走线绕到远处接地。
图2：环路面积最小化是高频率耦的关键
同一块板子，换个位置，纹波降了一半回到我开头说的那块Buck电路板。
按照上面四条原则重新改版：我把0.1μF小电容挪到IC引脚正下方，10μF大电容移到电源入口处，每个电容的过孔都紧贴焊盘，走线宽度加粗到0.3mm以上。
改版回来一测，纹波从80mV直接掉到了35mV。没加任何一个新电容，只是调整了位置。
这大概就是硬件设计的魔力所在——有时候花200块买示波器抓问题，不如花20分钟把走线改短2mm。
最后说一句写这篇文章的时候，我又翻了一遍之前的调试记录。其实很多电源问题，说到底不是什么高深理论，就是layout不讲究。
电容往哪儿摆、走线怎么走、过孔打在哪里，这些看起来琐碎的细节，才是决定板子能不能稳定工作的关键。设计不是堆料，是理解原理之后的精准放置。
希望这篇文章能帮你少走点弯路。
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