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【Allegro软件PCB设计120问解析】第25问 Allegro软件如何导入封装本身的引脚长度信息呢？
答：我们在时序等长时，除了考虑信号线的走线的长度以外，在高速设计领域里还需要考虑封装本身的引脚长度。所谓封装引脚长度，指的就是元器件封装内部的引脚长度，这个长度一般芯片的厂家会提供这数据，我们要做的就是将数据导入到规则管理器中，与等长一起处理，具体的操作步骤如下：
2021-03-22 16:21:57
AD布线的时候如何模块 我布线电源部分 只显示电源部分的飞线 其他飞线全部隐藏？
提问于
2020-04-02 17:29
AD布线的时候如何模块 我布线电源部分 只显示电源部分的飞线 其他飞线全部隐藏？
AD布线的时候如何模块 我布线电源部分 只显示电源部分的飞线 其他飞线全部隐藏？ 比如图片交互之后 模块分开然后处理电源部分· 其他部分飞线不显示
1 个回答
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更多大神们，可不可帮我在下面的AD转换程序基础上，为了精确点，弄下多次采集电压的平均值的程序，我也试过了，由于刚学单片机不久，都是失败。 #include"stc12c5a60s2" unsigned char data adc_dat =0x30; void main(void) { unsigne
请问为什么我的元器件旁边都有问号？
Altium/Protel
老师，还有个问题想问下。4层板上有混合信号的话，在板子顶、底层是需要分割数字地、模拟地。那么内电层，第二层GND也需要分割吗？然后在顶层的一个位置，把数字地、模拟地连接起来？第三层电源层需要分割嘛？我看有的板子是把第三层PWR模拟部分也作为模拟地了
2020-03-09 11:29修改
老师，还有个问题想问下。4层板上有混合信号的话，在板子顶、底层是需要分割数字地、模拟地。那么内电层，第二层GND也需要分割吗？然后在顶层的一个位置，把数字地、模拟地连接起来？第三层电源层需要分割嘛？我看有的板子是把第三层PWR模拟部分也作为模拟地了
原理图这两个节点有什么不同吗？
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