找到 “管脚放置” 相关内容 条
  • 全部
  • 默认排序

电源信号建议铺铜处理:注意电源模块的布局。输入输出都是铺铜处理:电感底部不要走线:上述一致原因:建议看下自己的电源模块设计需要优化。晶振前面的滤波电容位置是否反了 走线是要π型滤波 gnd管脚放置外部来将晶振进行包地处理:上述一致问题:等长

Allegro-全能20期-肖平铮-第八次作业-四层达芬奇板PCB设计

晶振靠近管脚放置,尽量少打孔换层,包地处理2.差分包地地线上需要多打地过孔3.器件摆放尽量对齐处理4.注意过孔不要上焊盘后期自己检查一下过孔上焊盘和过孔重叠5.信号包地应该用地网络,不要用电源6.SD卡组内误差不能超过400mil7.注意走

90天全能特训班18期 allegro -觅一惘 -STM32

跨接电容旁边进行多打地过孔,不同的地间距建议2mm2.器件干涉3.SDRAM等长还存在没有达到目标值4.走线尽量不要从电阻电容中间穿5.滤波电容应该靠近输入管脚放置以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班

90天全能特训班15期 AD-lzhong-达芬奇-作业评审

此处电源输入没有进行铺铜打孔连通2.两个过孔不满足载流3.反馈要从电容后面取样4.电感下面尽量你要走线5.电源没有连通6.滤波电容应该靠近管脚放置7.后期自己在底层铺一块整版地铜进行连接以上评审报告来源于凡亿教育90天高速PCB特训班作业评

90天全能特训班18期pads -江恒-PMU

电源输出的滤波电容要靠近输出管脚放置2.USB的电容放置不到位,应该线经过电容在连接到USB器件,差分出线要耦合出线,走在一起3.器件干涉4.SDRAM的滤波电容尽量保证一个管脚一个5.顶底层器件干涉,顶层器件是插件,你底层也放器件,后期不

立创EDA梁山派-uae作业评审报告

晶振布局、布线错误,晶振的一对线要走成类差分的形式, 线尽量短如下图。typec的LCD_R4、LCD_R5要建立差分对走差分阻抗控制90欧姆做对内等长,换层需要靠近过孔打回流地过孔,D7、D8应该尽量靠近typec管脚放置。TF卡所有信号

立创EDA梁山派-郭付根作业评审报告

电源输入电容应该靠近管脚放置输出电容电阻应该靠近管脚放置到电感后面输出3.3v晶振布局错误,晶振的一对线要走成类差分的形式, 线尽量短如下图。typec的LCD_R4、LCD_R5要走差分阻抗控制90欧姆做对内等长,差分走线尽量减少打孔换层

立创EDA梁山派-岳孝昱作业评审报告

锯齿状等长不能超过线距的两倍2.线宽尽量保持一致3.时钟要靠近管脚放置,并且包地处理4.走线也不规范,需要优化一下5.此处电源不满足载流6.TX和RX需要添加class,并进行等长处理,误差100mil7.TX,RX之间需要走一根20mil

90天全能特训班18期-allegro-邹信锦-百兆网口

pcb上存在短路2.滤波电容靠近管脚放置,走线加粗3.晶振下面尽量不要走线4.此处电源不满足载流5.变压器所有层挖空6.变压器除差分信号外,其他信号都需要加粗到20mil7.差分线对内等长处理不当,锯齿状等长凸起高度不能超过线距的两倍8.走

90天全能特训班16期AD-晨曦-千兆网口-作业评审

此处电源走线不满足载流,走线加粗或者铺铜处理2.滤波电容靠近管脚放置3.走线可以在优化一下,尽量不要有锐角4.HDMI差分对内等长误差5mil,对间误差10mil5.差分出线需要优化一下,走线尽量满足差分间距规则6.器件干涉7.滤波电容尽量

90天全能特训班18期allegro-杨旭-HDMI