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走线未连接到过孔中心2.差分出线需要优化一下3.线宽突变,确认一下具体线宽,尽量保持统一4.电源一层连通,无需打孔5.差分处理不规范,锯齿状等长不能超过线距的两倍6.pcb上存在开路7.RJ45座子需要挖空以上评审报告来源于凡亿教育90天高

90天全能特训班17期AD-花生果汁-百兆-作业评审

1.电源输入的滤波电容应该靠近输入管脚(4脚)放置2.差分线处理不当,锯齿状等长,凸起高度不得超过线距的两倍3.差分要尽量耦合出线,后期自己调整一下走线路劲4.此处电源出线载流瓶颈,电流计算都是以最窄处铜皮计算的5.线宽突变,确认一下具体线

立创EDA梁山派-周嘉杰作业评审报告

数据线等长存在报错2.走线尽量不要走直角,建议钝角3.此处走线需要优化一下4.走线未连接到过孔中心,存在开路5.此处出线载流瓶颈,自己加宽铜皮6.注意过孔不要上焊盘7.地和电源都需要加粗8.地就近打孔,缩短回流路劲9.差分出线要尽量耦合10

90天全能特训班17期AD-花生果汁-2DDR

差分对尽量少换层差分对内等长误差5mil232模块C+,C-;V+,V-所接的电容属于升压电容,注意布 局尽量靠近,走线加粗。sd卡模块数据线整组包地处理以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访

90天全能特训班21期-A.涤生-AD21_第七次作业-AD- STM32最小系统板PCB设计

差分信号之间要用GND隔开:差分需要包地处理:此处打了两个孔,连接也两个都连接上,不然另一个孔没有意义:注意差分信号都需要包地处理:注意差分对内等长gap需要大于等于3w:没满足的都去重新等长下。差分对内等长误差为5MIL:以上评审报告来源

全能19期-Charlie 吴-第5次组作业-USB 2.0/3.0&Type-C模块PCB设计

Altium Designer 21在之前版本的基础上对蛇形等长功能进行了优化,大大提高了设计的效率和规范性,具体改进可以参考以下说明。1.1新增两种等长样式 在之前的版本设计当中,等长设计时只有单一的U形等长。Altium Designe

Altium Designer 21全新功能- 蛇形等长快捷调节

1、在ad24的PCB设计中,按完快捷键TM之后,复位了错误标志,该如何再显示DRC报错?尝试之后,有些地方存在drc问题,但不报错,只有去移动的时候才会重新报错。该怎么解决?2、在X signals等长走线中,为什么会有这些飞线?该怎么关

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焰火 2024-04-26 13:41:56

RX TX没有设置等长组以及等长误差进行等长:注意RX TX信号可以走一根GND走线进行分隔开:其他的没什么问题了。以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:https://

Allegro-全能22期-曾定宏-Allegro-第一次作业 RJ45网口模块的PCB设计

差分需要按照阻抗线距走,后期埃及调整一下2.差分对内等长凸起高度不能超过线距的两倍网口座子需要靠近板框摆放3.差分出线要尽量耦合,走线需要优化一下4.时钟信号包地需要在地线上打孔,建议50mil-100mil一个以上评审报告来源于凡亿教育9

90天全能特训班21期AD-ZJC-百兆网口