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dcdc要求单点接地，如果背面铺铜就不是单点接地了。不要从焊盘侧面出线还有未完成的连接焊盘中心散热地过孔没打以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教：https://item
晶振需要包地，并且打上地过孔2.确认一下此处是否满足载流，自己加粗线宽3.差分包地需要在地线上打上地过孔4.差分线处理不当，锯齿状等长，凸起高度不得超过线距的两倍5.RS232尽量不要同层布线，如需同层建议间隔5W以上，不要走差分以上评审报
差分走线不满足差分间距规则2.锯齿状等长不能超过线距的两倍3.差分对内等长误差5mil4.ESD器件尽量靠近接口管脚放置5.包地 地线上尽量多打地过孔以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访
答：我们在进行差分布线设计的时候，特别是高速信号差分，在进行打孔换层的时候，都会在旁边添加回流地过孔，若差分信号比较多的时候，去添加，就非常繁琐，也容易遗漏，我么这里讲解一下，如何去进行自动添加，具体操作如下所示：
电源输出要从输出电容后面进行连接2.晶振需要包地处理，下面不要走别的信号线，包地需要打孔3.RS232 的升压电容走线需要加粗处理4.电源走线尽量加粗导20mil，满足载流5.USB尽量包地处理，并间隔100-150mil打上地过孔6.注意
机壳地与电路地之间至少满足2MM间距：GND铜皮跟GND焊盘并未连接：需要设置铜皮属性之后再去重新灌铜：跨接器件两边的地可以多放置地过孔：晶振底部不要走线：TX RX直接用GND走线隔开：信号线不要从电阻电容内部走线，更改下路径：以上评审报
差分走线需要再优化一下2.此处差分尽量打孔换层，在旁边添加一对回流地过孔，包地即可3.电容靠近管脚放置，走线优化一下，不要有锐角4.焊盘中心出线至外部才能拐线处理，避免生产出现虚焊5.存在多处开路6.差分需要进行对内等长，误差5mil7.R
1，焊盘有开路。2.pcb存在drc4.多处孤岛铜皮和尖岬铜皮4.走线保持3w间距4.走线避免锐角5.差分换层旁边要打地过孔6.晶振布线错误，晶振的一对线要走成类差分的形式，并整体包地处理， 线尽量短如下图8.同层连接不需要打孔9.时钟线要
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