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​我们在进行PCB设计的时候,最后我们需要去进行DRC的检查,检查完成之后会出现各种总各样的报错,当然其中常见的间距报错,规则报错我们都知道怎么更改,也能看懂大概的意思。可以有时候碰到一些比较少见的报错,就会不知道这个报错的原因是什么 了。

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AD中DRC检查Isolated copper:Split pllane.... 报错?

这个问题怎么解决啊,我实际走的是20mil,为啥还是报错

我们在进行PCB设计的时候,最后我们需要去进行DRC的检查,检查完成之后会出现各种总各样的报错,当然其中常见的间距报错,规则报错我们都知道怎么更改,也能看懂大概的意思。可以有时候碰到一些比较少见的报错,就会不知道这个报错的原因是什么 了。比如今天要讲解的DRC报错中的“Isolated copper:Split pllane....”的报错,为了方便大家了解这项报错,我们找到了素材图片如下:

Altium Designer中DRC检查Isolated copper报错

器件叠着器件为什么不会报错,规则都设置了?

导入规则的时候,提示这个错误咋回事,都是英文的,没有非法字符,应该导出为什么格式呢,求指导下,

加了个bga区域规则报错想删,删不掉

规则报错some rules have incorroect definitions,would you like to correct them?这是啥原因哪里不正确

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规则设置提示红色标示,说规则有错误,是什么原因?如何更改?

过孔打到焊盘上,咋不报错呢

请看图片中,红色部分是哪里有问题