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90天全能特训班18期allegro-觅一惘-2DDR

2023-05-22 11:02

1753

1SDRAM

注意数据线等长存在报错

2DDR

注意差分出线呀尽量耦合

2.差分线对内等长处理不当，锯齿状等长不能超过线距的两倍

3.差分要设置对内等长误差5mil

4.滤波电容尽量保证一个管脚一个，靠近管脚摆放

5.注意电源管脚扇孔走线需要加粗

以上评审报告来源于凡亿教育90天高速PCB特训班作业评审

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采用单点接地，此处可以不用打孔2.pcb上存在开路，电源没有连通3.反馈线10mil即可4.在底层铺一块整版铜对地进行连接以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教：https

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答：在生成的Gerber中，除了要将PCB上的走线、过孔等内容包含进去，还需要将PCB的叠层等信息制作进去，以便提供详细的文件给工厂生产，Allegro提供了一个直接提取设计参数生成的叠层表格的功能，减少了设计者的工作量。

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当布线效果不理想时，，调整布线状态时，一根一根改比较费时，可以采用删除命令，将不需要的线删除后，重新布线。

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